diff --git a/gcc/testsuite/gcc.target/riscv/rvv/base/mask_insn_shortcut.c b/gcc/testsuite/gcc.target/riscv/rvv/base/mask_insn_shortcut.c
new file mode 100644
index 00000000000..8310aabaf59
--- /dev/null
+++ b/gcc/testsuite/gcc.target/riscv/rvv/base/mask_insn_shortcut.c
@@ -0,0 +1,237 @@
+/* { dg-do compile } */
+/* { dg-options "-march=rv64gcv -mabi=lp64 -O3" } */
+
+#include "riscv_vector.h"
+
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+  return __riscv_vmand_mm_b1(v1, v1, vl);
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+
+vbool2_t test_shortcut_for_riscv_vmand_case_1(vbool2_t v1, size_t vl) {
+  return __riscv_vmand_mm_b2(v1, v1, vl);
+}
+
+vbool4_t test_shortcut_for_riscv_vmand_case_2(vbool4_t v1, size_t vl) {
+  return __riscv_vmand_mm_b4(v1, v1, vl);
+}
+
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+  return __riscv_vmand_mm_b8(v1, v1, vl);
+}
+
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+  return __riscv_vmand_mm_b16(v1, v1, vl);
+}
+
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+  return __riscv_vmand_mm_b32(v1, v1, vl);
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+
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+  return __riscv_vmand_mm_b64(v1, v1, vl);
+}
+
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+  return __riscv_vmnand_mm_b1(v1, v1, vl);
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+  return __riscv_vmnand_mm_b2(v1, v1, vl);
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+  return __riscv_vmnand_mm_b4(v1, v1, vl);
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+/* { dg-final { scan-assembler-not {vmxnor\.mm\s+v[0-9]+,\s*v[0-9]+} } } */
