From patchwork Tue Feb 14 14:28:24 2023 Content-Type: text/plain; charset="utf-8" MIME-Version: 1.0 Content-Transfer-Encoding: 7bit X-Patchwork-Submitter: "juzhe.zhong@rivai.ai" X-Patchwork-Id: 57028 Return-Path: Delivered-To: ouuuleilei@gmail.com Received: by 2002:adf:eb09:0:0:0:0:0 with SMTP id s9csp3005613wrn; Tue, 14 Feb 2023 06:29:30 -0800 (PST) X-Google-Smtp-Source: AK7set/I5WlCR/VRyDV3pO53kmtIT1gEVENuKT2nx32Vkv9UqOH/h0ypswQei3f/zve4Vcs+/7lV X-Received: by 2002:a17:906:35c4:b0:8af:370a:c1f8 with SMTP id p4-20020a17090635c400b008af370ac1f8mr3177562ejb.23.1676384970254; Tue, 14 Feb 2023 06:29:30 -0800 (PST) ARC-Seal: i=1; a=rsa-sha256; t=1676384970; cv=none; d=google.com; s=arc-20160816; b=QKi4Fnta2YUImWNjk7vjYs73/dHx4C/fDBKNeaNf8WBd15KYZLK1XQ4TnYGg8MrEN0 Y6GenuoEbIkS5N8/a70RG0329HBDoElnZ5B6XdQCy4R+zbw/mybhS1vGBFHV19hJi/zk rw9BXTjzcL35gYNjScltZq/H2K864jaaBZPSi0A+QeAvHIxap3tI83AOQ+xjVY1PCgMQ ElF3HWAkSCyhMfel3Z1Ka2woocKox0VT3IKxb7bGrPNo0ALJFBz8SdLD/1gm34Z9pDSy uI5U2ImW9AgLjtTf3gNCFMXAwpYv3it9L16omiw57NI837VmnkAnqwpQNaikfL1QKszK kb/A== ARC-Message-Signature: i=1; a=rsa-sha256; c=relaxed/relaxed; d=google.com; s=arc-20160816; h=sender:errors-to:list-subscribe:list-help:list-post:list-archive :list-unsubscribe:list-id:precedence:feedback-id :content-transfer-encoding:mime-version:message-id:date:subject:cc :to:from:dmarc-filter:delivered-to; bh=/JcM5qj4GaTk/hCSFzo1EF9WuLb2IbdEqvHoQIN33ZY=; b=aTItcqmt+u3jDgDP1CmBgMNC42saYuwuxjwcycw9CKefox9KZPwAlGorUD+vkHWWut JTFZzclnTG1p+8vZL4KPMnWTw2gAyP9+jY7H8yUtuVkHNnXBaw/qHi1kdvdpPVICK2TC EFcxYSIGSxyG3XJvRobpPfh7/iHSYMlfxFwcEbG0hHGvLrgsVXxjz1eZdd/+zBc29tW5 cwkBYUnvNwerW/UBe2fHo15AS0GCKVMRDgmqjyZovHdM23LX+sIQq398Gm22zze3+MA1 kQYFPmySeZ0e/+D3SLaq7T8gGfhRxHODxQNkizOMPWIvcyfhHqXVZylA/nYtwXJUqBiQ Ap1A== ARC-Authentication-Results: i=1; mx.google.com; spf=pass (google.com: domain of gcc-patches-bounces+ouuuleilei=gmail.com@gcc.gnu.org designates 8.43.85.97 as permitted sender) smtp.mailfrom="gcc-patches-bounces+ouuuleilei=gmail.com@gcc.gnu.org" Received: from sourceware.org (ip-8-43-85-97.sourceware.org. [8.43.85.97]) by mx.google.com with ESMTPS id z10-20020a17090674ca00b008aeb6beee40si22815913ejl.325.2023.02.14.06.29.29 for (version=TLS1_3 cipher=TLS_AES_256_GCM_SHA384 bits=256/256); Tue, 14 Feb 2023 06:29:30 -0800 (PST) Received-SPF: pass (google.com: domain of gcc-patches-bounces+ouuuleilei=gmail.com@gcc.gnu.org designates 8.43.85.97 as permitted sender) client-ip=8.43.85.97; Authentication-Results: mx.google.com; spf=pass (google.com: domain of gcc-patches-bounces+ouuuleilei=gmail.com@gcc.gnu.org designates 8.43.85.97 as permitted sender) smtp.mailfrom="gcc-patches-bounces+ouuuleilei=gmail.com@gcc.gnu.org" Received: from server2.sourceware.org (localhost [IPv6:::1]) by sourceware.org (Postfix) with ESMTP id A6257385B52C for ; Tue, 14 Feb 2023 14:29:12 +0000 (GMT) X-Original-To: gcc-patches@gcc.gnu.org Delivered-To: gcc-patches@gcc.gnu.org Received: from smtpbgsg1.qq.com (smtpbgsg1.qq.com [54.254.200.92]) by sourceware.org (Postfix) with ESMTPS id 8A6E93858D1E for ; Tue, 14 Feb 2023 14:28:31 +0000 (GMT) DMARC-Filter: OpenDMARC Filter v1.4.2 sourceware.org 8A6E93858D1E Authentication-Results: sourceware.org; dmarc=none (p=none dis=none) header.from=rivai.ai Authentication-Results: sourceware.org; spf=pass smtp.mailfrom=rivai.ai X-QQ-mid: bizesmtp90t1676384906tx6kjozl Received: from rios-cad5.localdomain ( [58.60.1.11]) by bizesmtp.qq.com (ESMTP) with id ; Tue, 14 Feb 2023 22:28:25 +0800 (CST) X-QQ-SSF: 01400000002000E0L000B00A0000000 X-QQ-FEAT: jXjag1m6xl4zEFqiUOQsN5baJyDuQIlPm3z061DNhmZlydqGvU/IrlgRzhUJt CdwblH3TkAB1e/NUaj33CjSbtj0antCmGF1Rq+ciAbeEB05xo9r4tlS9Y4z0IQrsU+Y3XaF vJEuvRfM+XJV07kKiagCmdRO03zNwqUNiGf0B8omwfW2dwwHOQ02lr5kPW4ZVQ3BuK48VZX dIDM5m3SaV9gFm5BpOM708IPFSQfpkquX6RyntrHXlHMyHBuYwQrguVPPSQEn/pF+xjSGYh rjJr0niQbDthideOqPYb9zjHaa5qsqySuuuV+MCTzcjYg52+hatoYxpVs8j896qJnuumQHO Oxsg3nwva9UQaniXr5dQDS09oBf74GOQHxa4j61U3zLa+TEKlqhgUXdN3Mm99VK2RlDVdIY X-QQ-GoodBg: 2 From: juzhe.zhong@rivai.ai To: gcc-patches@gcc.gnu.org Cc: kito.cheng@gmail.com, Ju-Zhe Zhong Subject: [PATCH] RISC-V: Add vmadd vv c++ api test Date: Tue, 14 Feb 2023 22:28:24 +0800 Message-Id: <20230214142825.154358-1-juzhe.zhong@rivai.ai> X-Mailer: git-send-email 2.36.3 MIME-Version: 1.0 X-QQ-SENDSIZE: 520 Feedback-ID: bizesmtp:rivai.ai:qybglogicsvr:qybglogicsvr7 X-Spam-Status: No, score=-12.9 required=5.0 tests=BAYES_00, GIT_PATCH_0, KAM_DMARC_STATUS, RCVD_IN_DNSWL_NONE, RCVD_IN_MSPIKE_H2, SPF_HELO_PASS, SPF_PASS, TXREP autolearn=ham autolearn_force=no version=3.4.6 X-Spam-Checker-Version: SpamAssassin 3.4.6 (2021-04-09) on server2.sourceware.org X-BeenThere: gcc-patches@gcc.gnu.org X-Mailman-Version: 2.1.29 Precedence: list List-Id: Gcc-patches mailing list List-Unsubscribe: , List-Archive: List-Post: List-Help: List-Subscribe: , Errors-To: gcc-patches-bounces+ouuuleilei=gmail.com@gcc.gnu.org Sender: "Gcc-patches" X-getmail-retrieved-from-mailbox: =?utf-8?q?INBOX?= X-GMAIL-THRID: =?utf-8?q?1757817046441332493?= X-GMAIL-MSGID: =?utf-8?q?1757817046441332493?= From: Ju-Zhe Zhong gcc/testsuite/ChangeLog: * g++.target/riscv/rvv/base/vmadd_vv-1.C: New test. * g++.target/riscv/rvv/base/vmadd_vv-2.C: New test. * g++.target/riscv/rvv/base/vmadd_vv-3.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_mu-1.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_mu-2.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_mu-3.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tu-1.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tu-2.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tu-3.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tum-1.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tum-2.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tum-3.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tumu-1.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tumu-2.C: New test. * g++.target/riscv/rvv/base/vmadd_vv_tumu-3.C: New test. --- .../g++.target/riscv/rvv/base/vmadd_vv-1.C | 578 ++++++++++++++++++ .../g++.target/riscv/rvv/base/vmadd_vv-2.C | 578 ++++++++++++++++++ .../g++.target/riscv/rvv/base/vmadd_vv-3.C | 578 ++++++++++++++++++ .../g++.target/riscv/rvv/base/vmadd_vv_mu-1.C | 292 +++++++++ .../g++.target/riscv/rvv/base/vmadd_vv_mu-2.C | 292 +++++++++ .../g++.target/riscv/rvv/base/vmadd_vv_mu-3.C | 292 +++++++++ .../g++.target/riscv/rvv/base/vmadd_vv_tu-1.C | 292 +++++++++ .../g++.target/riscv/rvv/base/vmadd_vv_tu-2.C | 292 +++++++++ .../g++.target/riscv/rvv/base/vmadd_vv_tu-3.C | 292 +++++++++ .../riscv/rvv/base/vmadd_vv_tum-1.C | 292 +++++++++ .../riscv/rvv/base/vmadd_vv_tum-2.C | 292 +++++++++ .../riscv/rvv/base/vmadd_vv_tum-3.C | 292 +++++++++ .../riscv/rvv/base/vmadd_vv_tumu-1.C | 292 +++++++++ .../riscv/rvv/base/vmadd_vv_tumu-2.C | 292 +++++++++ .../riscv/rvv/base/vmadd_vv_tumu-3.C | 292 +++++++++ 15 files changed, 5238 insertions(+) create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-1.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-2.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-3.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-1.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-2.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-3.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-1.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-2.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-3.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-1.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-2.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-3.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-1.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-2.C create mode 100644 gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-3.C diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-1.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-1.C new file mode 100644 index 00000000000..4fa82f5b217 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-1.C @@ -0,0 +1,578 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd(vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8mf4_t test___riscv_vmadd(vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8mf2_t test___riscv_vmadd(vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8m1_t test___riscv_vmadd(vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8m2_t test___riscv_vmadd(vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8m4_t test___riscv_vmadd(vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8m8_t test___riscv_vmadd(vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint16mf4_t test___riscv_vmadd(vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint16mf2_t test___riscv_vmadd(vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint16m1_t test___riscv_vmadd(vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint16m2_t test___riscv_vmadd(vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint16m4_t test___riscv_vmadd(vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint16m8_t test___riscv_vmadd(vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint32mf2_t test___riscv_vmadd(vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint32m1_t test___riscv_vmadd(vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint32m2_t test___riscv_vmadd(vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint32m4_t test___riscv_vmadd(vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint32m8_t test___riscv_vmadd(vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint64m1_t test___riscv_vmadd(vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint64m2_t test___riscv_vmadd(vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint64m4_t test___riscv_vmadd(vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint64m8_t test___riscv_vmadd(vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8mf8_t test___riscv_vmadd(vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8mf4_t test___riscv_vmadd(vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8mf2_t test___riscv_vmadd(vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8m1_t test___riscv_vmadd(vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8m2_t test___riscv_vmadd(vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8m4_t test___riscv_vmadd(vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint8m8_t test___riscv_vmadd(vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint16mf4_t test___riscv_vmadd(vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint16mf2_t test___riscv_vmadd(vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint16m1_t test___riscv_vmadd(vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint16m2_t test___riscv_vmadd(vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint16m4_t test___riscv_vmadd(vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint16m8_t test___riscv_vmadd(vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint32mf2_t test___riscv_vmadd(vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint32m1_t test___riscv_vmadd(vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint32m2_t test___riscv_vmadd(vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint32m4_t test___riscv_vmadd(vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint32m8_t test___riscv_vmadd(vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint64m1_t test___riscv_vmadd(vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint64m2_t test___riscv_vmadd(vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint64m4_t test___riscv_vmadd(vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vuint64m8_t test___riscv_vmadd(vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,vl); +} + + +vint8mf8_t test___riscv_vmadd(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint8mf4_t test___riscv_vmadd(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint8mf2_t test___riscv_vmadd(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint8m1_t test___riscv_vmadd(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint8m2_t test___riscv_vmadd(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint8m4_t test___riscv_vmadd(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint8m8_t test___riscv_vmadd(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint16mf4_t test___riscv_vmadd(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint16mf2_t test___riscv_vmadd(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint16m1_t test___riscv_vmadd(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint16m2_t test___riscv_vmadd(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint16m4_t test___riscv_vmadd(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint16m8_t test___riscv_vmadd(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint32mf2_t test___riscv_vmadd(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint32m1_t test___riscv_vmadd(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint32m2_t test___riscv_vmadd(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint32m4_t test___riscv_vmadd(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint32m8_t test___riscv_vmadd(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint64m1_t test___riscv_vmadd(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint64m2_t test___riscv_vmadd(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint64m4_t test___riscv_vmadd(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vint64m8_t test___riscv_vmadd(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8mf8_t test___riscv_vmadd(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8mf4_t test___riscv_vmadd(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8mf2_t test___riscv_vmadd(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8m1_t test___riscv_vmadd(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8m2_t test___riscv_vmadd(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8m4_t test___riscv_vmadd(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint8m8_t test___riscv_vmadd(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint16mf4_t test___riscv_vmadd(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint16mf2_t test___riscv_vmadd(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint16m1_t test___riscv_vmadd(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint16m2_t test___riscv_vmadd(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint16m4_t test___riscv_vmadd(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint16m8_t test___riscv_vmadd(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint32mf2_t test___riscv_vmadd(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint32m1_t test___riscv_vmadd(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint32m2_t test___riscv_vmadd(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint32m4_t test___riscv_vmadd(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint32m8_t test___riscv_vmadd(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint64m1_t test___riscv_vmadd(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint64m2_t test___riscv_vmadd(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint64m4_t test___riscv_vmadd(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + +vuint64m8_t test___riscv_vmadd(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,vl); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-2.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-2.C new file mode 100644 index 00000000000..4247725b85c --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-2.C @@ -0,0 +1,578 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd(vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8mf4_t test___riscv_vmadd(vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8mf2_t test___riscv_vmadd(vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8m1_t test___riscv_vmadd(vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8m2_t test___riscv_vmadd(vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8m4_t test___riscv_vmadd(vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8m8_t test___riscv_vmadd(vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint16mf4_t test___riscv_vmadd(vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint16mf2_t test___riscv_vmadd(vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint16m1_t test___riscv_vmadd(vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint16m2_t test___riscv_vmadd(vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint16m4_t test___riscv_vmadd(vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint16m8_t test___riscv_vmadd(vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint32mf2_t test___riscv_vmadd(vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint32m1_t test___riscv_vmadd(vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint32m2_t test___riscv_vmadd(vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint32m4_t test___riscv_vmadd(vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint32m8_t test___riscv_vmadd(vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint64m1_t test___riscv_vmadd(vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint64m2_t test___riscv_vmadd(vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint64m4_t test___riscv_vmadd(vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint64m8_t test___riscv_vmadd(vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8mf8_t test___riscv_vmadd(vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8mf4_t test___riscv_vmadd(vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8mf2_t test___riscv_vmadd(vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8m1_t test___riscv_vmadd(vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8m2_t test___riscv_vmadd(vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8m4_t test___riscv_vmadd(vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint8m8_t test___riscv_vmadd(vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint16mf4_t test___riscv_vmadd(vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint16mf2_t test___riscv_vmadd(vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint16m1_t test___riscv_vmadd(vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint16m2_t test___riscv_vmadd(vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint16m4_t test___riscv_vmadd(vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint16m8_t test___riscv_vmadd(vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint32mf2_t test___riscv_vmadd(vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint32m1_t test___riscv_vmadd(vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint32m2_t test___riscv_vmadd(vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint32m4_t test___riscv_vmadd(vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint32m8_t test___riscv_vmadd(vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint64m1_t test___riscv_vmadd(vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint64m2_t test___riscv_vmadd(vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint64m4_t test___riscv_vmadd(vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vuint64m8_t test___riscv_vmadd(vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,31); +} + + +vint8mf8_t test___riscv_vmadd(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint8mf4_t test___riscv_vmadd(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint8mf2_t test___riscv_vmadd(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint8m1_t test___riscv_vmadd(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint8m2_t test___riscv_vmadd(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint8m4_t test___riscv_vmadd(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint8m8_t test___riscv_vmadd(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint16mf4_t test___riscv_vmadd(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint16mf2_t test___riscv_vmadd(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint16m1_t test___riscv_vmadd(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint16m2_t test___riscv_vmadd(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint16m4_t test___riscv_vmadd(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint16m8_t test___riscv_vmadd(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint32mf2_t test___riscv_vmadd(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint32m1_t test___riscv_vmadd(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint32m2_t test___riscv_vmadd(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint32m4_t test___riscv_vmadd(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint32m8_t test___riscv_vmadd(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint64m1_t test___riscv_vmadd(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint64m2_t test___riscv_vmadd(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint64m4_t test___riscv_vmadd(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vint64m8_t test___riscv_vmadd(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8mf8_t test___riscv_vmadd(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8mf4_t test___riscv_vmadd(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8mf2_t test___riscv_vmadd(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8m1_t test___riscv_vmadd(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8m2_t test___riscv_vmadd(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8m4_t test___riscv_vmadd(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint8m8_t test___riscv_vmadd(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint16mf4_t test___riscv_vmadd(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint16mf2_t test___riscv_vmadd(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint16m1_t test___riscv_vmadd(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint16m2_t test___riscv_vmadd(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint16m4_t test___riscv_vmadd(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint16m8_t test___riscv_vmadd(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint32mf2_t test___riscv_vmadd(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint32m1_t test___riscv_vmadd(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint32m2_t test___riscv_vmadd(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint32m4_t test___riscv_vmadd(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint32m8_t test___riscv_vmadd(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint64m1_t test___riscv_vmadd(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint64m2_t test___riscv_vmadd(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint64m4_t test___riscv_vmadd(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + +vuint64m8_t test___riscv_vmadd(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,31); +} + + + +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-3.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-3.C new file mode 100644 index 00000000000..2a28913d471 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv-3.C @@ -0,0 +1,578 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd(vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8mf4_t test___riscv_vmadd(vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8mf2_t test___riscv_vmadd(vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8m1_t test___riscv_vmadd(vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8m2_t test___riscv_vmadd(vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8m4_t test___riscv_vmadd(vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8m8_t test___riscv_vmadd(vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint16mf4_t test___riscv_vmadd(vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint16mf2_t test___riscv_vmadd(vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint16m1_t test___riscv_vmadd(vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint16m2_t test___riscv_vmadd(vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint16m4_t test___riscv_vmadd(vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint16m8_t test___riscv_vmadd(vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint32mf2_t test___riscv_vmadd(vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint32m1_t test___riscv_vmadd(vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint32m2_t test___riscv_vmadd(vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint32m4_t test___riscv_vmadd(vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint32m8_t test___riscv_vmadd(vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint64m1_t test___riscv_vmadd(vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint64m2_t test___riscv_vmadd(vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint64m4_t test___riscv_vmadd(vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint64m8_t test___riscv_vmadd(vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8mf8_t test___riscv_vmadd(vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8mf4_t test___riscv_vmadd(vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8mf2_t test___riscv_vmadd(vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8m1_t test___riscv_vmadd(vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8m2_t test___riscv_vmadd(vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8m4_t test___riscv_vmadd(vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint8m8_t test___riscv_vmadd(vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint16mf4_t test___riscv_vmadd(vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint16mf2_t test___riscv_vmadd(vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint16m1_t test___riscv_vmadd(vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint16m2_t test___riscv_vmadd(vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint16m4_t test___riscv_vmadd(vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint16m8_t test___riscv_vmadd(vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint32mf2_t test___riscv_vmadd(vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint32m1_t test___riscv_vmadd(vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint32m2_t test___riscv_vmadd(vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint32m4_t test___riscv_vmadd(vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint32m8_t test___riscv_vmadd(vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint64m1_t test___riscv_vmadd(vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint64m2_t test___riscv_vmadd(vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint64m4_t test___riscv_vmadd(vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vuint64m8_t test___riscv_vmadd(vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(vd,vs1,vs2,32); +} + + +vint8mf8_t test___riscv_vmadd(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint8mf4_t test___riscv_vmadd(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint8mf2_t test___riscv_vmadd(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint8m1_t test___riscv_vmadd(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint8m2_t test___riscv_vmadd(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint8m4_t test___riscv_vmadd(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint8m8_t test___riscv_vmadd(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint16mf4_t test___riscv_vmadd(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint16mf2_t test___riscv_vmadd(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint16m1_t test___riscv_vmadd(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint16m2_t test___riscv_vmadd(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint16m4_t test___riscv_vmadd(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint16m8_t test___riscv_vmadd(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint32mf2_t test___riscv_vmadd(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint32m1_t test___riscv_vmadd(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint32m2_t test___riscv_vmadd(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint32m4_t test___riscv_vmadd(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint32m8_t test___riscv_vmadd(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint64m1_t test___riscv_vmadd(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint64m2_t test___riscv_vmadd(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint64m4_t test___riscv_vmadd(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vint64m8_t test___riscv_vmadd(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8mf8_t test___riscv_vmadd(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8mf4_t test___riscv_vmadd(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8mf2_t test___riscv_vmadd(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8m1_t test___riscv_vmadd(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8m2_t test___riscv_vmadd(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8m4_t test___riscv_vmadd(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint8m8_t test___riscv_vmadd(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint16mf4_t test___riscv_vmadd(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint16mf2_t test___riscv_vmadd(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint16m1_t test___riscv_vmadd(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint16m2_t test___riscv_vmadd(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint16m4_t test___riscv_vmadd(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint16m8_t test___riscv_vmadd(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint32mf2_t test___riscv_vmadd(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint32m1_t test___riscv_vmadd(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint32m2_t test___riscv_vmadd(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint32m4_t test___riscv_vmadd(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint32m8_t test___riscv_vmadd(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint64m1_t test___riscv_vmadd(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint64m2_t test___riscv_vmadd(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint64m4_t test___riscv_vmadd(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + +vuint64m8_t test___riscv_vmadd(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd(mask,vd,vs1,vs2,32); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*t[au],\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-1.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-1.C new file mode 100644 index 00000000000..2c46df45e03 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_mu(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint8mf4_t test___riscv_vmadd_mu(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint8mf2_t test___riscv_vmadd_mu(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint8m1_t test___riscv_vmadd_mu(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint8m2_t test___riscv_vmadd_mu(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint8m4_t test___riscv_vmadd_mu(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint8m8_t test___riscv_vmadd_mu(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint16mf4_t test___riscv_vmadd_mu(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint16mf2_t test___riscv_vmadd_mu(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint16m1_t test___riscv_vmadd_mu(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint16m2_t test___riscv_vmadd_mu(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint16m4_t test___riscv_vmadd_mu(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint16m8_t test___riscv_vmadd_mu(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint32mf2_t test___riscv_vmadd_mu(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint32m1_t test___riscv_vmadd_mu(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint32m2_t test___riscv_vmadd_mu(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint32m4_t test___riscv_vmadd_mu(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint32m8_t test___riscv_vmadd_mu(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint64m1_t test___riscv_vmadd_mu(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint64m2_t test___riscv_vmadd_mu(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint64m4_t test___riscv_vmadd_mu(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vint64m8_t test___riscv_vmadd_mu(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8mf8_t test___riscv_vmadd_mu(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8mf4_t test___riscv_vmadd_mu(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8mf2_t test___riscv_vmadd_mu(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8m1_t test___riscv_vmadd_mu(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8m2_t test___riscv_vmadd_mu(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8m4_t test___riscv_vmadd_mu(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint8m8_t test___riscv_vmadd_mu(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint16mf4_t test___riscv_vmadd_mu(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint16mf2_t test___riscv_vmadd_mu(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint16m1_t test___riscv_vmadd_mu(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint16m2_t test___riscv_vmadd_mu(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint16m4_t test___riscv_vmadd_mu(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint16m8_t test___riscv_vmadd_mu(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint32mf2_t test___riscv_vmadd_mu(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint32m1_t test___riscv_vmadd_mu(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint32m2_t test___riscv_vmadd_mu(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint32m4_t test___riscv_vmadd_mu(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint32m8_t test___riscv_vmadd_mu(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint64m1_t test___riscv_vmadd_mu(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint64m2_t test___riscv_vmadd_mu(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint64m4_t test___riscv_vmadd_mu(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + +vuint64m8_t test___riscv_vmadd_mu(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,vl); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-2.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-2.C new file mode 100644 index 00000000000..78038158962 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-2.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_mu(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint8mf4_t test___riscv_vmadd_mu(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint8mf2_t test___riscv_vmadd_mu(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint8m1_t test___riscv_vmadd_mu(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint8m2_t test___riscv_vmadd_mu(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint8m4_t test___riscv_vmadd_mu(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint8m8_t test___riscv_vmadd_mu(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint16mf4_t test___riscv_vmadd_mu(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint16mf2_t test___riscv_vmadd_mu(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint16m1_t test___riscv_vmadd_mu(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint16m2_t test___riscv_vmadd_mu(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint16m4_t test___riscv_vmadd_mu(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint16m8_t test___riscv_vmadd_mu(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint32mf2_t test___riscv_vmadd_mu(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint32m1_t test___riscv_vmadd_mu(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint32m2_t test___riscv_vmadd_mu(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint32m4_t test___riscv_vmadd_mu(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint32m8_t test___riscv_vmadd_mu(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint64m1_t test___riscv_vmadd_mu(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint64m2_t test___riscv_vmadd_mu(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint64m4_t test___riscv_vmadd_mu(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vint64m8_t test___riscv_vmadd_mu(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8mf8_t test___riscv_vmadd_mu(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8mf4_t test___riscv_vmadd_mu(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8mf2_t test___riscv_vmadd_mu(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8m1_t test___riscv_vmadd_mu(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8m2_t test___riscv_vmadd_mu(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8m4_t test___riscv_vmadd_mu(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint8m8_t test___riscv_vmadd_mu(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint16mf4_t test___riscv_vmadd_mu(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint16mf2_t test___riscv_vmadd_mu(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint16m1_t test___riscv_vmadd_mu(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint16m2_t test___riscv_vmadd_mu(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint16m4_t test___riscv_vmadd_mu(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint16m8_t test___riscv_vmadd_mu(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint32mf2_t test___riscv_vmadd_mu(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint32m1_t test___riscv_vmadd_mu(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint32m2_t test___riscv_vmadd_mu(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint32m4_t test___riscv_vmadd_mu(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint32m8_t test___riscv_vmadd_mu(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint64m1_t test___riscv_vmadd_mu(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint64m2_t test___riscv_vmadd_mu(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint64m4_t test___riscv_vmadd_mu(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + +vuint64m8_t test___riscv_vmadd_mu(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,31); +} + + + +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-3.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-3.C new file mode 100644 index 00000000000..46601837c87 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_mu-3.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_mu(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint8mf4_t test___riscv_vmadd_mu(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint8mf2_t test___riscv_vmadd_mu(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint8m1_t test___riscv_vmadd_mu(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint8m2_t test___riscv_vmadd_mu(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint8m4_t test___riscv_vmadd_mu(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint8m8_t test___riscv_vmadd_mu(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint16mf4_t test___riscv_vmadd_mu(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint16mf2_t test___riscv_vmadd_mu(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint16m1_t test___riscv_vmadd_mu(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint16m2_t test___riscv_vmadd_mu(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint16m4_t test___riscv_vmadd_mu(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint16m8_t test___riscv_vmadd_mu(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint32mf2_t test___riscv_vmadd_mu(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint32m1_t test___riscv_vmadd_mu(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint32m2_t test___riscv_vmadd_mu(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint32m4_t test___riscv_vmadd_mu(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint32m8_t test___riscv_vmadd_mu(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint64m1_t test___riscv_vmadd_mu(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint64m2_t test___riscv_vmadd_mu(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint64m4_t test___riscv_vmadd_mu(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vint64m8_t test___riscv_vmadd_mu(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8mf8_t test___riscv_vmadd_mu(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8mf4_t test___riscv_vmadd_mu(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8mf2_t test___riscv_vmadd_mu(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8m1_t test___riscv_vmadd_mu(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8m2_t test___riscv_vmadd_mu(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8m4_t test___riscv_vmadd_mu(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint8m8_t test___riscv_vmadd_mu(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint16mf4_t test___riscv_vmadd_mu(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint16mf2_t test___riscv_vmadd_mu(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint16m1_t test___riscv_vmadd_mu(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint16m2_t test___riscv_vmadd_mu(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint16m4_t test___riscv_vmadd_mu(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint16m8_t test___riscv_vmadd_mu(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint32mf2_t test___riscv_vmadd_mu(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint32m1_t test___riscv_vmadd_mu(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint32m2_t test___riscv_vmadd_mu(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint32m4_t test___riscv_vmadd_mu(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint32m8_t test___riscv_vmadd_mu(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint64m1_t test___riscv_vmadd_mu(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint64m2_t test___riscv_vmadd_mu(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint64m4_t test___riscv_vmadd_mu(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + +vuint64m8_t test___riscv_vmadd_mu(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_mu(mask,vd,vs1,vs2,32); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*t[au],\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-1.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-1.C new file mode 100644 index 00000000000..b8fc69ee341 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tu(vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint8mf4_t test___riscv_vmadd_tu(vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint8mf2_t test___riscv_vmadd_tu(vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint8m1_t test___riscv_vmadd_tu(vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint8m2_t test___riscv_vmadd_tu(vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint8m4_t test___riscv_vmadd_tu(vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint8m8_t test___riscv_vmadd_tu(vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint16mf4_t test___riscv_vmadd_tu(vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint16mf2_t test___riscv_vmadd_tu(vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint16m1_t test___riscv_vmadd_tu(vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint16m2_t test___riscv_vmadd_tu(vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint16m4_t test___riscv_vmadd_tu(vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint16m8_t test___riscv_vmadd_tu(vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint32mf2_t test___riscv_vmadd_tu(vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint32m1_t test___riscv_vmadd_tu(vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint32m2_t test___riscv_vmadd_tu(vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint32m4_t test___riscv_vmadd_tu(vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint32m8_t test___riscv_vmadd_tu(vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint64m1_t test___riscv_vmadd_tu(vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint64m2_t test___riscv_vmadd_tu(vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint64m4_t test___riscv_vmadd_tu(vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vint64m8_t test___riscv_vmadd_tu(vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8mf8_t test___riscv_vmadd_tu(vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8mf4_t test___riscv_vmadd_tu(vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8mf2_t test___riscv_vmadd_tu(vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8m1_t test___riscv_vmadd_tu(vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8m2_t test___riscv_vmadd_tu(vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8m4_t test___riscv_vmadd_tu(vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint8m8_t test___riscv_vmadd_tu(vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint16mf4_t test___riscv_vmadd_tu(vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint16mf2_t test___riscv_vmadd_tu(vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint16m1_t test___riscv_vmadd_tu(vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint16m2_t test___riscv_vmadd_tu(vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint16m4_t test___riscv_vmadd_tu(vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint16m8_t test___riscv_vmadd_tu(vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint32mf2_t test___riscv_vmadd_tu(vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint32m1_t test___riscv_vmadd_tu(vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint32m2_t test___riscv_vmadd_tu(vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint32m4_t test___riscv_vmadd_tu(vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint32m8_t test___riscv_vmadd_tu(vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint64m1_t test___riscv_vmadd_tu(vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint64m2_t test___riscv_vmadd_tu(vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint64m4_t test___riscv_vmadd_tu(vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + +vuint64m8_t test___riscv_vmadd_tu(vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,vl); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-2.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-2.C new file mode 100644 index 00000000000..d0b82b8cf70 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-2.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tu(vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint8mf4_t test___riscv_vmadd_tu(vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint8mf2_t test___riscv_vmadd_tu(vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint8m1_t test___riscv_vmadd_tu(vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint8m2_t test___riscv_vmadd_tu(vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint8m4_t test___riscv_vmadd_tu(vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint8m8_t test___riscv_vmadd_tu(vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint16mf4_t test___riscv_vmadd_tu(vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint16mf2_t test___riscv_vmadd_tu(vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint16m1_t test___riscv_vmadd_tu(vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint16m2_t test___riscv_vmadd_tu(vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint16m4_t test___riscv_vmadd_tu(vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint16m8_t test___riscv_vmadd_tu(vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint32mf2_t test___riscv_vmadd_tu(vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint32m1_t test___riscv_vmadd_tu(vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint32m2_t test___riscv_vmadd_tu(vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint32m4_t test___riscv_vmadd_tu(vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint32m8_t test___riscv_vmadd_tu(vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint64m1_t test___riscv_vmadd_tu(vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint64m2_t test___riscv_vmadd_tu(vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint64m4_t test___riscv_vmadd_tu(vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vint64m8_t test___riscv_vmadd_tu(vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8mf8_t test___riscv_vmadd_tu(vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8mf4_t test___riscv_vmadd_tu(vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8mf2_t test___riscv_vmadd_tu(vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8m1_t test___riscv_vmadd_tu(vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8m2_t test___riscv_vmadd_tu(vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8m4_t test___riscv_vmadd_tu(vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint8m8_t test___riscv_vmadd_tu(vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint16mf4_t test___riscv_vmadd_tu(vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint16mf2_t test___riscv_vmadd_tu(vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint16m1_t test___riscv_vmadd_tu(vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint16m2_t test___riscv_vmadd_tu(vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint16m4_t test___riscv_vmadd_tu(vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint16m8_t test___riscv_vmadd_tu(vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint32mf2_t test___riscv_vmadd_tu(vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint32m1_t test___riscv_vmadd_tu(vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint32m2_t test___riscv_vmadd_tu(vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint32m4_t test___riscv_vmadd_tu(vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint32m8_t test___riscv_vmadd_tu(vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint64m1_t test___riscv_vmadd_tu(vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint64m2_t test___riscv_vmadd_tu(vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint64m4_t test___riscv_vmadd_tu(vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + +vuint64m8_t test___riscv_vmadd_tu(vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,31); +} + + + +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-3.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-3.C new file mode 100644 index 00000000000..5f7e8af609b --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tu-3.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tu(vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint8mf4_t test___riscv_vmadd_tu(vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint8mf2_t test___riscv_vmadd_tu(vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint8m1_t test___riscv_vmadd_tu(vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint8m2_t test___riscv_vmadd_tu(vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint8m4_t test___riscv_vmadd_tu(vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint8m8_t test___riscv_vmadd_tu(vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint16mf4_t test___riscv_vmadd_tu(vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint16mf2_t test___riscv_vmadd_tu(vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint16m1_t test___riscv_vmadd_tu(vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint16m2_t test___riscv_vmadd_tu(vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint16m4_t test___riscv_vmadd_tu(vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint16m8_t test___riscv_vmadd_tu(vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint32mf2_t test___riscv_vmadd_tu(vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint32m1_t test___riscv_vmadd_tu(vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint32m2_t test___riscv_vmadd_tu(vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint32m4_t test___riscv_vmadd_tu(vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint32m8_t test___riscv_vmadd_tu(vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint64m1_t test___riscv_vmadd_tu(vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint64m2_t test___riscv_vmadd_tu(vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint64m4_t test___riscv_vmadd_tu(vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vint64m8_t test___riscv_vmadd_tu(vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8mf8_t test___riscv_vmadd_tu(vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8mf4_t test___riscv_vmadd_tu(vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8mf2_t test___riscv_vmadd_tu(vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8m1_t test___riscv_vmadd_tu(vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8m2_t test___riscv_vmadd_tu(vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8m4_t test___riscv_vmadd_tu(vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint8m8_t test___riscv_vmadd_tu(vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint16mf4_t test___riscv_vmadd_tu(vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint16mf2_t test___riscv_vmadd_tu(vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint16m1_t test___riscv_vmadd_tu(vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint16m2_t test___riscv_vmadd_tu(vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint16m4_t test___riscv_vmadd_tu(vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint16m8_t test___riscv_vmadd_tu(vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint32mf2_t test___riscv_vmadd_tu(vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint32m1_t test___riscv_vmadd_tu(vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint32m2_t test___riscv_vmadd_tu(vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint32m4_t test___riscv_vmadd_tu(vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint32m8_t test___riscv_vmadd_tu(vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint64m1_t test___riscv_vmadd_tu(vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint64m2_t test___riscv_vmadd_tu(vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint64m4_t test___riscv_vmadd_tu(vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + +vuint64m8_t test___riscv_vmadd_tu(vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tu(vd,vs1,vs2,32); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-1.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-1.C new file mode 100644 index 00000000000..356b3251310 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tum(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint8mf4_t test___riscv_vmadd_tum(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint8mf2_t test___riscv_vmadd_tum(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint8m1_t test___riscv_vmadd_tum(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint8m2_t test___riscv_vmadd_tum(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint8m4_t test___riscv_vmadd_tum(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint8m8_t test___riscv_vmadd_tum(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint16mf4_t test___riscv_vmadd_tum(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint16mf2_t test___riscv_vmadd_tum(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint16m1_t test___riscv_vmadd_tum(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint16m2_t test___riscv_vmadd_tum(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint16m4_t test___riscv_vmadd_tum(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint16m8_t test___riscv_vmadd_tum(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint32mf2_t test___riscv_vmadd_tum(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint32m1_t test___riscv_vmadd_tum(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint32m2_t test___riscv_vmadd_tum(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint32m4_t test___riscv_vmadd_tum(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint32m8_t test___riscv_vmadd_tum(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint64m1_t test___riscv_vmadd_tum(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint64m2_t test___riscv_vmadd_tum(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint64m4_t test___riscv_vmadd_tum(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vint64m8_t test___riscv_vmadd_tum(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8mf8_t test___riscv_vmadd_tum(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8mf4_t test___riscv_vmadd_tum(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8mf2_t test___riscv_vmadd_tum(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8m1_t test___riscv_vmadd_tum(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8m2_t test___riscv_vmadd_tum(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8m4_t test___riscv_vmadd_tum(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint8m8_t test___riscv_vmadd_tum(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint16mf4_t test___riscv_vmadd_tum(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint16mf2_t test___riscv_vmadd_tum(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint16m1_t test___riscv_vmadd_tum(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint16m2_t test___riscv_vmadd_tum(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint16m4_t test___riscv_vmadd_tum(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint16m8_t test___riscv_vmadd_tum(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint32mf2_t test___riscv_vmadd_tum(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint32m1_t test___riscv_vmadd_tum(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint32m2_t test___riscv_vmadd_tum(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint32m4_t test___riscv_vmadd_tum(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint32m8_t test___riscv_vmadd_tum(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint64m1_t test___riscv_vmadd_tum(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint64m2_t test___riscv_vmadd_tum(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint64m4_t test___riscv_vmadd_tum(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + +vuint64m8_t test___riscv_vmadd_tum(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,vl); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-2.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-2.C new file mode 100644 index 00000000000..0271aaa73cc --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-2.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tum(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint8mf4_t test___riscv_vmadd_tum(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint8mf2_t test___riscv_vmadd_tum(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint8m1_t test___riscv_vmadd_tum(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint8m2_t test___riscv_vmadd_tum(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint8m4_t test___riscv_vmadd_tum(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint8m8_t test___riscv_vmadd_tum(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint16mf4_t test___riscv_vmadd_tum(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint16mf2_t test___riscv_vmadd_tum(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint16m1_t test___riscv_vmadd_tum(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint16m2_t test___riscv_vmadd_tum(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint16m4_t test___riscv_vmadd_tum(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint16m8_t test___riscv_vmadd_tum(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint32mf2_t test___riscv_vmadd_tum(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint32m1_t test___riscv_vmadd_tum(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint32m2_t test___riscv_vmadd_tum(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint32m4_t test___riscv_vmadd_tum(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint32m8_t test___riscv_vmadd_tum(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint64m1_t test___riscv_vmadd_tum(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint64m2_t test___riscv_vmadd_tum(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint64m4_t test___riscv_vmadd_tum(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vint64m8_t test___riscv_vmadd_tum(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8mf8_t test___riscv_vmadd_tum(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8mf4_t test___riscv_vmadd_tum(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8mf2_t test___riscv_vmadd_tum(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8m1_t test___riscv_vmadd_tum(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8m2_t test___riscv_vmadd_tum(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8m4_t test___riscv_vmadd_tum(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint8m8_t test___riscv_vmadd_tum(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint16mf4_t test___riscv_vmadd_tum(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint16mf2_t test___riscv_vmadd_tum(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint16m1_t test___riscv_vmadd_tum(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint16m2_t test___riscv_vmadd_tum(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint16m4_t test___riscv_vmadd_tum(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint16m8_t test___riscv_vmadd_tum(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint32mf2_t test___riscv_vmadd_tum(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint32m1_t test___riscv_vmadd_tum(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint32m2_t test___riscv_vmadd_tum(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint32m4_t test___riscv_vmadd_tum(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint32m8_t test___riscv_vmadd_tum(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint64m1_t test___riscv_vmadd_tum(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint64m2_t test___riscv_vmadd_tum(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint64m4_t test___riscv_vmadd_tum(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + +vuint64m8_t test___riscv_vmadd_tum(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,31); +} + + + +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-3.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-3.C new file mode 100644 index 00000000000..f53b64f0f51 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tum-3.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tum(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint8mf4_t test___riscv_vmadd_tum(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint8mf2_t test___riscv_vmadd_tum(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint8m1_t test___riscv_vmadd_tum(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint8m2_t test___riscv_vmadd_tum(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint8m4_t test___riscv_vmadd_tum(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint8m8_t test___riscv_vmadd_tum(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint16mf4_t test___riscv_vmadd_tum(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint16mf2_t test___riscv_vmadd_tum(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint16m1_t test___riscv_vmadd_tum(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint16m2_t test___riscv_vmadd_tum(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint16m4_t test___riscv_vmadd_tum(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint16m8_t test___riscv_vmadd_tum(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint32mf2_t test___riscv_vmadd_tum(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint32m1_t test___riscv_vmadd_tum(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint32m2_t test___riscv_vmadd_tum(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint32m4_t test___riscv_vmadd_tum(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint32m8_t test___riscv_vmadd_tum(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint64m1_t test___riscv_vmadd_tum(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint64m2_t test___riscv_vmadd_tum(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint64m4_t test___riscv_vmadd_tum(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vint64m8_t test___riscv_vmadd_tum(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8mf8_t test___riscv_vmadd_tum(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8mf4_t test___riscv_vmadd_tum(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8mf2_t test___riscv_vmadd_tum(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8m1_t test___riscv_vmadd_tum(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8m2_t test___riscv_vmadd_tum(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8m4_t test___riscv_vmadd_tum(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint8m8_t test___riscv_vmadd_tum(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint16mf4_t test___riscv_vmadd_tum(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint16mf2_t test___riscv_vmadd_tum(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint16m1_t test___riscv_vmadd_tum(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint16m2_t test___riscv_vmadd_tum(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint16m4_t test___riscv_vmadd_tum(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint16m8_t test___riscv_vmadd_tum(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint32mf2_t test___riscv_vmadd_tum(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint32m1_t test___riscv_vmadd_tum(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint32m2_t test___riscv_vmadd_tum(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint32m4_t test___riscv_vmadd_tum(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint32m8_t test___riscv_vmadd_tum(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint64m1_t test___riscv_vmadd_tum(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint64m2_t test___riscv_vmadd_tum(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint64m4_t test___riscv_vmadd_tum(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + +vuint64m8_t test___riscv_vmadd_tum(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tum(mask,vd,vs1,vs2,32); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*tu,\s*m[au]\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-1.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-1.C new file mode 100644 index 00000000000..eec276302c8 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-1.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tumu(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint8mf4_t test___riscv_vmadd_tumu(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint8mf2_t test___riscv_vmadd_tumu(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint8m1_t test___riscv_vmadd_tumu(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint8m2_t test___riscv_vmadd_tumu(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint8m4_t test___riscv_vmadd_tumu(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint8m8_t test___riscv_vmadd_tumu(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint16mf4_t test___riscv_vmadd_tumu(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint16mf2_t test___riscv_vmadd_tumu(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint16m1_t test___riscv_vmadd_tumu(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint16m2_t test___riscv_vmadd_tumu(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint16m4_t test___riscv_vmadd_tumu(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint16m8_t test___riscv_vmadd_tumu(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint32mf2_t test___riscv_vmadd_tumu(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint32m1_t test___riscv_vmadd_tumu(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint32m2_t test___riscv_vmadd_tumu(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint32m4_t test___riscv_vmadd_tumu(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint32m8_t test___riscv_vmadd_tumu(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint64m1_t test___riscv_vmadd_tumu(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint64m2_t test___riscv_vmadd_tumu(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint64m4_t test___riscv_vmadd_tumu(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vint64m8_t test___riscv_vmadd_tumu(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8mf8_t test___riscv_vmadd_tumu(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8mf4_t test___riscv_vmadd_tumu(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8mf2_t test___riscv_vmadd_tumu(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8m1_t test___riscv_vmadd_tumu(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8m2_t test___riscv_vmadd_tumu(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8m4_t test___riscv_vmadd_tumu(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint8m8_t test___riscv_vmadd_tumu(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint16mf4_t test___riscv_vmadd_tumu(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint16mf2_t test___riscv_vmadd_tumu(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint16m1_t test___riscv_vmadd_tumu(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint16m2_t test___riscv_vmadd_tumu(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint16m4_t test___riscv_vmadd_tumu(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint16m8_t test___riscv_vmadd_tumu(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint32mf2_t test___riscv_vmadd_tumu(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint32m1_t test___riscv_vmadd_tumu(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint32m2_t test___riscv_vmadd_tumu(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint32m4_t test___riscv_vmadd_tumu(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint32m8_t test___riscv_vmadd_tumu(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint64m1_t test___riscv_vmadd_tumu(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint64m2_t test___riscv_vmadd_tumu(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint64m4_t test___riscv_vmadd_tumu(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + +vuint64m8_t test___riscv_vmadd_tumu(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,vl); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-2.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-2.C new file mode 100644 index 00000000000..dd4e422bde2 --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-2.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tumu(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint8mf4_t test___riscv_vmadd_tumu(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint8mf2_t test___riscv_vmadd_tumu(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint8m1_t test___riscv_vmadd_tumu(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint8m2_t test___riscv_vmadd_tumu(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint8m4_t test___riscv_vmadd_tumu(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint8m8_t test___riscv_vmadd_tumu(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint16mf4_t test___riscv_vmadd_tumu(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint16mf2_t test___riscv_vmadd_tumu(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint16m1_t test___riscv_vmadd_tumu(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint16m2_t test___riscv_vmadd_tumu(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint16m4_t test___riscv_vmadd_tumu(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint16m8_t test___riscv_vmadd_tumu(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint32mf2_t test___riscv_vmadd_tumu(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint32m1_t test___riscv_vmadd_tumu(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint32m2_t test___riscv_vmadd_tumu(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint32m4_t test___riscv_vmadd_tumu(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint32m8_t test___riscv_vmadd_tumu(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint64m1_t test___riscv_vmadd_tumu(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint64m2_t test___riscv_vmadd_tumu(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint64m4_t test___riscv_vmadd_tumu(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vint64m8_t test___riscv_vmadd_tumu(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8mf8_t test___riscv_vmadd_tumu(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8mf4_t test___riscv_vmadd_tumu(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8mf2_t test___riscv_vmadd_tumu(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8m1_t test___riscv_vmadd_tumu(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8m2_t test___riscv_vmadd_tumu(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8m4_t test___riscv_vmadd_tumu(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint8m8_t test___riscv_vmadd_tumu(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint16mf4_t test___riscv_vmadd_tumu(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint16mf2_t test___riscv_vmadd_tumu(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint16m1_t test___riscv_vmadd_tumu(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint16m2_t test___riscv_vmadd_tumu(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint16m4_t test___riscv_vmadd_tumu(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint16m8_t test___riscv_vmadd_tumu(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint32mf2_t test___riscv_vmadd_tumu(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint32m1_t test___riscv_vmadd_tumu(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint32m2_t test___riscv_vmadd_tumu(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint32m4_t test___riscv_vmadd_tumu(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint32m8_t test___riscv_vmadd_tumu(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint64m1_t test___riscv_vmadd_tumu(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint64m2_t test___riscv_vmadd_tumu(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint64m4_t test___riscv_vmadd_tumu(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + +vuint64m8_t test___riscv_vmadd_tumu(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,31); +} + + + +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e8,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e16,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e32,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetivli\s+zero,\s*31,\s*e64,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ diff --git a/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-3.C b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-3.C new file mode 100644 index 00000000000..6789e83271e --- /dev/null +++ b/gcc/testsuite/g++.target/riscv/rvv/base/vmadd_vv_tumu-3.C @@ -0,0 +1,292 @@ +/* { dg-do compile } */ +/* { dg-options "-march=rv64gcv -mabi=lp64d -O3 -fno-schedule-insns -fno-schedule-insns2" } */ + +#include "riscv_vector.h" + +vint8mf8_t test___riscv_vmadd_tumu(vbool64_t mask,vint8mf8_t vd,vint8mf8_t vs1,vint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint8mf4_t test___riscv_vmadd_tumu(vbool32_t mask,vint8mf4_t vd,vint8mf4_t vs1,vint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint8mf2_t test___riscv_vmadd_tumu(vbool16_t mask,vint8mf2_t vd,vint8mf2_t vs1,vint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint8m1_t test___riscv_vmadd_tumu(vbool8_t mask,vint8m1_t vd,vint8m1_t vs1,vint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint8m2_t test___riscv_vmadd_tumu(vbool4_t mask,vint8m2_t vd,vint8m2_t vs1,vint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint8m4_t test___riscv_vmadd_tumu(vbool2_t mask,vint8m4_t vd,vint8m4_t vs1,vint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint8m8_t test___riscv_vmadd_tumu(vbool1_t mask,vint8m8_t vd,vint8m8_t vs1,vint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint16mf4_t test___riscv_vmadd_tumu(vbool64_t mask,vint16mf4_t vd,vint16mf4_t vs1,vint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint16mf2_t test___riscv_vmadd_tumu(vbool32_t mask,vint16mf2_t vd,vint16mf2_t vs1,vint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint16m1_t test___riscv_vmadd_tumu(vbool16_t mask,vint16m1_t vd,vint16m1_t vs1,vint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint16m2_t test___riscv_vmadd_tumu(vbool8_t mask,vint16m2_t vd,vint16m2_t vs1,vint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint16m4_t test___riscv_vmadd_tumu(vbool4_t mask,vint16m4_t vd,vint16m4_t vs1,vint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint16m8_t test___riscv_vmadd_tumu(vbool2_t mask,vint16m8_t vd,vint16m8_t vs1,vint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint32mf2_t test___riscv_vmadd_tumu(vbool64_t mask,vint32mf2_t vd,vint32mf2_t vs1,vint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint32m1_t test___riscv_vmadd_tumu(vbool32_t mask,vint32m1_t vd,vint32m1_t vs1,vint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint32m2_t test___riscv_vmadd_tumu(vbool16_t mask,vint32m2_t vd,vint32m2_t vs1,vint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint32m4_t test___riscv_vmadd_tumu(vbool8_t mask,vint32m4_t vd,vint32m4_t vs1,vint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint32m8_t test___riscv_vmadd_tumu(vbool4_t mask,vint32m8_t vd,vint32m8_t vs1,vint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint64m1_t test___riscv_vmadd_tumu(vbool64_t mask,vint64m1_t vd,vint64m1_t vs1,vint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint64m2_t test___riscv_vmadd_tumu(vbool32_t mask,vint64m2_t vd,vint64m2_t vs1,vint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint64m4_t test___riscv_vmadd_tumu(vbool16_t mask,vint64m4_t vd,vint64m4_t vs1,vint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vint64m8_t test___riscv_vmadd_tumu(vbool8_t mask,vint64m8_t vd,vint64m8_t vs1,vint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8mf8_t test___riscv_vmadd_tumu(vbool64_t mask,vuint8mf8_t vd,vuint8mf8_t vs1,vuint8mf8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8mf4_t test___riscv_vmadd_tumu(vbool32_t mask,vuint8mf4_t vd,vuint8mf4_t vs1,vuint8mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8mf2_t test___riscv_vmadd_tumu(vbool16_t mask,vuint8mf2_t vd,vuint8mf2_t vs1,vuint8mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8m1_t test___riscv_vmadd_tumu(vbool8_t mask,vuint8m1_t vd,vuint8m1_t vs1,vuint8m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8m2_t test___riscv_vmadd_tumu(vbool4_t mask,vuint8m2_t vd,vuint8m2_t vs1,vuint8m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8m4_t test___riscv_vmadd_tumu(vbool2_t mask,vuint8m4_t vd,vuint8m4_t vs1,vuint8m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint8m8_t test___riscv_vmadd_tumu(vbool1_t mask,vuint8m8_t vd,vuint8m8_t vs1,vuint8m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint16mf4_t test___riscv_vmadd_tumu(vbool64_t mask,vuint16mf4_t vd,vuint16mf4_t vs1,vuint16mf4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint16mf2_t test___riscv_vmadd_tumu(vbool32_t mask,vuint16mf2_t vd,vuint16mf2_t vs1,vuint16mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint16m1_t test___riscv_vmadd_tumu(vbool16_t mask,vuint16m1_t vd,vuint16m1_t vs1,vuint16m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint16m2_t test___riscv_vmadd_tumu(vbool8_t mask,vuint16m2_t vd,vuint16m2_t vs1,vuint16m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint16m4_t test___riscv_vmadd_tumu(vbool4_t mask,vuint16m4_t vd,vuint16m4_t vs1,vuint16m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint16m8_t test___riscv_vmadd_tumu(vbool2_t mask,vuint16m8_t vd,vuint16m8_t vs1,vuint16m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint32mf2_t test___riscv_vmadd_tumu(vbool64_t mask,vuint32mf2_t vd,vuint32mf2_t vs1,vuint32mf2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint32m1_t test___riscv_vmadd_tumu(vbool32_t mask,vuint32m1_t vd,vuint32m1_t vs1,vuint32m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint32m2_t test___riscv_vmadd_tumu(vbool16_t mask,vuint32m2_t vd,vuint32m2_t vs1,vuint32m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint32m4_t test___riscv_vmadd_tumu(vbool8_t mask,vuint32m4_t vd,vuint32m4_t vs1,vuint32m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint32m8_t test___riscv_vmadd_tumu(vbool4_t mask,vuint32m8_t vd,vuint32m8_t vs1,vuint32m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint64m1_t test___riscv_vmadd_tumu(vbool64_t mask,vuint64m1_t vd,vuint64m1_t vs1,vuint64m1_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint64m2_t test___riscv_vmadd_tumu(vbool32_t mask,vuint64m2_t vd,vuint64m2_t vs1,vuint64m2_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint64m4_t test___riscv_vmadd_tumu(vbool16_t mask,vuint64m4_t vd,vuint64m4_t vs1,vuint64m4_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + +vuint64m8_t test___riscv_vmadd_tumu(vbool8_t mask,vuint64m8_t vd,vuint64m8_t vs1,vuint64m8_t vs2,size_t vl) +{ + return __riscv_vmadd_tumu(mask,vd,vs1,vs2,32); +} + + + +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e8,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e16,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*mf2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e32,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m1,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m2,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m4,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */ +/* { dg-final { scan-assembler-times {vsetvli\s+zero,\s*[a-x0-9]+,\s*e64,\s*m8,\s*tu,\s*mu\s+vma[c-d][c-d]\.vv\s+v[0-9]+,\s*v[0-9]+,\s*v[0-9]+,\s*v0.t\s+} 2 } } */